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实验十一MSI计数器的应用(二)

教材P309的实验五的实验任务3用MSI计数器74HC161(或74LS161)及74HC10、74HC04（或74LS10、74LS04）组成一个起始状态为0的60进制同步加法计数器,并测试其输入和输出的同步波形（在QUARTUSII7.2软件中仿真测试）,以检测电路的逻辑功能是否正确

。

补充：利用上述芯片设计按照BCD码计数规律的M=60，起始为0的同步计数器集美大学通信工程方怡冰利用输出3B作为共同的预置信号集美大学通信工程方怡冰集美大学通信工程方怡冰集美大学通信工程方怡冰0-59的M=60计数器集美大学通信工程方怡冰集美大学通信工程方怡冰实验十二用PLD设计时序逻辑电路(三)教材P334的实验八的实验任务1、21.用PLD设计一个能够自启动的依次循环出“1”和依次循环出“0”的可控移存型8位脉冲分配器,并用实验方法检测设计是否正确。2.用PLD设计一个移存型序列信号发生器,用来产生0111，0011，01序列信号,并检测其设计输出信号是否正确。集美大学通信工程方怡冰任务1集美大学通信工程方怡冰分配输出高、低电平控制电路集美大学通信工程方怡冰分配输出为0分配输出为1集美大学通信工程方怡冰任务2：产生0111，0011，010111，0011，01序列信号4位一组：0111，1110，1100，1001，0011，0110，1101，1010，0101，1011，共10组不重叠，所以K取4设计移存型序列信号发生器。Q3Q2Q1Q000011110001011011100110101集美大学通信工程方怡冰集美大学通信工程方怡冰集美大学通信工程方怡冰任务2：产生011

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