




下载本文档
版权说明:本文档由用户提供并上传,收益归属内容提供方,若内容存在侵权,请进行举报或认领
文档简介
本文格式为Word版,下载可任意编辑——EDA试验报告摘要(五篇)随着社会一步步向前发展,报告不再是罕见的东西,多数报告都是在事情做完或发生后撰写的。那么,报告终究怎么写才适合呢?下面是我为大家整理的报告范文,仅供参考,大家一起来看看吧。
EDA试验报告摘要篇四
eda课程试验报告
移位相加8位硬件乘法器电路计
ou1
移位相加硬件乘法器设计
一.试验目的
1、学习移位相加8位硬件乘法器电路设计;
2、学习应用eda技术进行项目设计的能力
二.试验原理
该乘法器是由8位加法器构成的以时序方式设计的8位乘法器。其乘法原理是:乘法通过逐项移位相加原理来实现,从被乘数的最低位开始,若
为1,则乘数左移后与上一次的和相加;若为0,左移后以全零相加,直至被乘数的最高位。
试验箱内部结构图
:
三.试验设备
1.安装quartusii软件的pc一台;
2.试验箱一个四.试验步骤
1.输入以下vhdl程序:
2.编译程序,并连接试验箱并下载3.在试验箱上按以下要求进行设置:
①选择模式1②clkk控制移位相加速度,接clock0=4hz③a[7..0]、b[7..0]输入数据显示于此4个数码管上
④dout[15..0]接数码管8/7/6/5,显示16位乘积:pio31—pio16⑤接键8(pio49):高电平清0,低电平计算允许
⑥a[7..0]接键2/1,输入8位乘数pio7—pio0(模式1)⑦b[7..0]接键2/1,输入8位被乘数pio7—pio0(模式1)
五.试验结果
试验程序编译运行后rtl电路图
ou1)2
(模式
试验rtl电路
a[7..0]接键2/1,输入8位乘数:a2(十六进制)b[7..0]接键4/3,输入8位被乘数:33(十六进制)可得结果dout[15..0]:2046(十六进制)六:心得体会
通过电子设计的数字部分eda设计,我们把握了系统的数字电子设计的方法,也知道了试验调试适配的具体操作方法。
通过试验,进一步加深了对eda的了解,让我对它有了浓重的兴趣。但是在调试程序时,遇到了不少问题,编译下载程序时,总是有错误,在细心的检查下,终究找出了错误和警告,排除困难后,程序编译就通过了,心里终究舒了一口气。
ou3
EDA试验报告摘要篇五
eda试验报告
张佳兴2220231738电气工程及其自动化1班
一、verilog语言反应硬件特性举例
cc(clk,en,cout)、input、output,这三个语句用verilog语言定义了一个规律器件,module后边括号内为端口名称,每个端口都对应硬件的一个引脚,引脚的输入输出性质都由input、output所定义,c语言中对变量的定义,都是int等反应数据大小的数据类型,不能反映硬件特性。
寄放器类型,表示一个具有保持作用的数据储存单元,它只能在always语句和initial语句中被赋值,并且它的值从一个赋值到另一个赋值被保存下来。这种类型就和实际芯片中的寄放器作用一样,可以将其中数据状态保存一定时间,c语言中没有这一类型。
语句当其检测到适当状态时,执行其中内容。always@(posedgeclk)语句就说明,检测到高电平执行,和实际芯片引脚状态变化引起内部变化原理一致,c语言中没有过程赋值这种语句,c中也没有对高低电平、上升下降沿的判断条件。
g语言中的模块例化,将各个模块程序在例化程序里结合起来,在硬件层面就相当于将各个小的模块相互连接,构成一个大的模块,c语言中类似的形式是函数,一个函数可以有子函数,但是c中的函数不能反应硬件特性。
二、数字频率计设计与调试总结
在进行课程设计的过程中我遇到了以下几点困难:
1.在最初设计时,没能利用硬件的思想来设计这个题目,导致频率频率计数的规律控制部分设计不清。在参考老师所提供的框图后了解应将规律控制部分单独设计成一个模块,通过en和clr来控制计数,这样技术部分就可以将之前的试验内容移植过来,十分简便。
2.在设计过程中的,锁存部分原理没有搞懂。依照老师的框图,从前向后分析,发现锁存的时钟clk是之前规律控制部分的lock引脚所提供,这样就将每个周期所计得的频率结果在同一个时序通过锁存器向后传输。
3.配置引脚时出错,将数码管的位选引脚顺序弄反,导致数码管显示错误。细心检查,发现错误,改正后正常运行。4.在拓展功能一的设计中,将十分频部分弄错,最终出来的结果和预期差了一些。在当堂试验课中,这个错误我没能及时改正,回来之后,我对应程序认真检查,发现我的十分频,被我设计成了逢9进1,导致最终结果错误。
5.发现了自己好多语法问题,譬如在过程赋值中对wire类型数据进行赋值导致错误,module定义的模块名称没有和文件名称对应导致错误等,最终我通过ppt及网络途径解决了这些问题。
在这次试验中,基本功能全部实现,并且是我自行制作,拓展功能一,同样是我自行完成,不过我当时得到的结果有误差,试验后我已经发现了问题,改正了错误。拓展功能二没有实现。
三、对课程的建议
1.我希望老师以后的试验过程中能够有一个答疑环节,在试验前,我们可以对预习中不懂的部分进行提问。
2
温馨提示
- 1. 本站所有资源如无特殊说明,都需要本地电脑安装OFFICE2007和PDF阅读器。图纸软件为CAD,CAXA,PROE,UG,SolidWorks等.压缩文件请下载最新的WinRAR软件解压。
- 2. 本站的文档不包含任何第三方提供的附件图纸等,如果需要附件,请联系上传者。文件的所有权益归上传用户所有。
- 3. 本站RAR压缩包中若带图纸,网页内容里面会有图纸预览,若没有图纸预览就没有图纸。
- 4. 未经权益所有人同意不得将文件中的内容挪作商业或盈利用途。
- 5. 人人文库网仅提供信息存储空间,仅对用户上传内容的表现方式做保护处理,对用户上传分享的文档内容本身不做任何修改或编辑,并不能对任何下载内容负责。
- 6. 下载文件中如有侵权或不适当内容,请与我们联系,我们立即纠正。
- 7. 本站不保证下载资源的准确性、安全性和完整性, 同时也不承担用户因使用这些下载资源对自己和他人造成任何形式的伤害或损失。
最新文档
- 2025-2030年中国锂电池正极材料市场发展趋势及投资战略研究报告
- 2025-2030年中国铝冶炼行业运行动态与前景趋势分析报告
- 2025-2030年中国菱镁矿产业竞争格局与十三五规划研究报告
- 2025-2030年中国联苯双酯行业市场运行状况与十三五规划分析报告
- 2025-2030年中国粘玉米行业规模分析及发展建议研究报告
- 2025-2030年中国空管系统市场十三五规划与投资战略研究报告
- 2025-2030年中国畜禽养殖中抗生素行业发展状况及投资战略研究报告
- 东北财经大学《中医护理学基础》2023-2024学年第二学期期末试卷
- 广东江门幼儿师范高等专科学校《面向对象与可视化编程》2023-2024学年第二学期期末试卷
- 广州工商学院《健康服务与营销学》2023-2024学年第二学期期末试卷
- 中华人民共和国学前教育法-知识培训
- 2023年新高考(新课标)全国2卷数学试题真题(含答案解析)
- 事业单位工作人员奖励审批表
- 人教版六年级美术下册全册课件【完整版】
- GB/T 9788-1988热轧不等边角钢尺寸、外形、重量及允许偏差
- 教科版三年级下册科学全册完整课件
- 上海小弄堂-电子小报
- 轨道交通安全专题培训
- 物理化学完整版答案
- 节流孔板孔径计算
- 学生流失率考核办法(试行)
评论
0/150
提交评论