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文档简介

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2、,基适合实现时序电是逻辑单元ACEXFPGA的LEACEXFPGA的LEPLD的设计工具与流PLD的设计工具与流设计输综布局布LatticeispMACH,LatticeispMACH,AlteraAlteraAcex、CycloneXilinx的I/O扩中断处的I/O扩中断处电源管扩展PS/2接PLD与CPU的接使用的Memory总PLD与CPU的接使用的Memory总线,模读写使用PLD时钟输2410-S的Altera MAX3000A系列2410-S的Altera MAX3000A系列EPM3128AT100, 128个宏单元,80个用户可用I/O, TQFP100封MAX3000A的开、调试电:AlteraMAX3000A的开、调试电:Altera的ACEX系列, ACEX系列, 内核电压EP1K30QC208 ,1700个逻辑单元,PQFP208封ACEX的开配置: ACEX的开配置: Al

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