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文档简介
数字电子技术II学习通超星期末考试章节答案2024年A/D转换器的二进制数的位数越多,量化单位△越小。
答案:对D/A转换器的位数越多,转换精度越高。
答案:对所有A/D转换器中的量化方法都是一样的。
答案:错在A/D转换过程中,必然会出现量化误差。
答案:对某模/数转换器的输入为0~5.1V模拟电压,输出为8位二进制数字信号(D7~D0)。则该模/数转换器能分辨的最小模拟电压为(
)。
答案:0.02V用二进制码表示指定离散电平的过程称为()。
答案:编码数字系统和模拟系统之间的接口常采用()。
答案:数/模和模/数转换器一个无符号8位数字量输入的DAC,其分辨率为()位。
答案:8常用的模数转换器中转换速度最快的是()。
答案:并行比较型模数转换器的转换精度与输出数字量的位数关系是(
)。
答案:输出的数字量位数越多转换精度越高
某数/模转换器的输入为8位二进制数字信号(D7~D0),输出为0~25.5V的模拟电压。若数字信号的最高位是“1”其余各位是“0”,则输出的模拟电压为(
)。
答案:12.8V一个4位倒T型电阻网络D/A转换器中,电阻网络的电阻取值有()种。
答案:2将一个时间上连续变化的模拟量转换为时间上断续(离散)的模拟量的过程称为()。
答案:取样为使采样输出信号不失真地代表输入模拟信号,采样频率fs和输入模拟信号的最高频率fimax的关系是()。
答案:fs2fimax74LS121是可重复触发单稳态触发器。
答案:错施密特触发器的正向阈值电压一定大于负向阈值电压。
答案:对单稳态触发器它有一个稳态和一个暂稳态。
答案:对无稳态多谐振荡器(
)
答案:没有稳定状态;是一个振荡器;产生周期脉冲输出/star3/origin/02b65b2aa67cbf883cfd07b82dbcbbb2.jpg
答案:单稳态触发器/star3/origin/274414dadfbb66a5540109a488e16673.png
答案:0.7RC/star3/origin/0c90e168617b35fc1fee45b4ef539562.jpg
答案:0.7R1C1/star3/origin/2a769c63d4dcb019e7b85df2b56904d2.png
答案:1.1RC/star3/origin/a77d2f49e344b3882e02aea0ac647db5.jpg
答案:施密特触发器用ROM可以实现各种组合逻辑函数。在设计实现时,只需列出真值表,逻辑函数的输入作为存储内容,输出作为地址,将内容按地址写入ROM即可。
答案:错一个16K×4的存储系统的起始地址为全0,其最高地址的十六进制地址码为3FFFH。
答案:对DRAM中存储的数据如果不进行周期性的刷新,其数据将会丢失;而SRAM中存储的数据无需刷新,只要电源不断电就可以永久保存。
答案:对将256×1位ROM扩展为1024×8位ROM,共需(
)片256×1位ROM。
答案:32将256×1位ROM扩展为1024×1位ROM,地址线为(
)根。
答案:10利用ROM实现两个4位二进制数相乘的功能,则该ROM的数据线有(
)根。
答案:8利用ROM实现两个4位二进制数相乘的功能,则该ROM的地址线有(
)根。
答案:8用ROM实现两个3位二进制数相乘的乘法器时,所需的容量为(
)。
答案:26×6位一个存储矩阵有64行、64列,则存储阵列的存储容量为(
)个存储单元。
答案:4KROM由存储阵列、地址译码器和(
)组成。
答案:输出控制电路任何一个同步时序逻辑电路的结构和功能可以用下面()函数表达式完整地描述。
答案:输出方程;状态转换方程/star3/origin/c302c4b6368089b8f70808be0bb1e640.png
答案:2500Hz三个D触发器构成模8的同步二进制加法计数器的初态为101,经2016个时钟后,计数器状态为()。
答案:101/star3/origin/8b28f3f235766cf12c10b24125eaf5d1.png
答案:T触发器米利(Mealy)型时序逻辑电路的输出()
答案:与外部输入和内部状态都有关/star3/origin/04668b892d3985d9224ddb2952ab5230.png
答案:十进制计数器/star3/origin/0a8a6a1f561f0ca5111dbed671b305b5.png
答案:七进制/star3/origin/e71b28e6f710362d60bd3591661ea7f7.png
答案:八进制/star3/origin/cc92895253aeadaaf4f68ab124cfb182.png
答案:图d关于时序电路与组合电路,下列说法错误的是()。
答案:时序电路由触发器构成,不含组合电路如果要构成模52计数器,需要74LVC161()片。
答案:2/star3/origin/25d1c64db27c458f09fbf8c4e90ba4e4.png
答案:对虽然传输门控D锁存器和逻辑门控D锁存器的电路结构不同,但逻辑功能是完全相同的。
答案:对边沿JK触发器在输入J=K=1时,如果CP信号的频率为32kHz,则Q端输出脉冲的频率为16kHz。
答案:对触发器CP输入端的三角形符号指的是()。
答案:边沿触发/star3/origin/a1cde0b38125d64cd0bef70043ed1f04.png
答案:0,1触发器有()个稳定状态,它可以存储1位二进制码,存储8位二进制信息需要()个触发器
答案:2,8对于门控D锁存器来说,在()条件下,输出端Q总是等于输入的数据D。
答案:使能脉冲期间/star3/origin/9eee3aa944c0d707f0a193f27d5201cc.png
答案:=0,=0用或非门构成的基本SR锁存器,其特性方程中,约束条件为SR=0。这说明两个输入信号()。
答案:不能同时为1当输入端S和R为(),由或非门构成的基本SR锁存器保持原状态不变。
答案:S=0,R=0以下关于锁存器和触发器描述正确的是()。
答案:锁存器是脉冲电平敏感器件,触发器是脉冲边沿敏感器件当一个逻辑门的两个输入端的信号同时向相反方向变化,而变化的时间有差异的现象,称为竞争。由竞争而可能产生输出干扰毛刺的现象称为冒险。
答案:对串行进位加法器的缺点是运算速度慢,优点是电路结构简单。超前进位加法器的优点是运算速度快,缺点是电路结构复杂。
答案:对实现两个一位二进制数相加的电路叫全加器。
答案:错一个n线-2n线译码器即一个1路-2n路数据分配器。
答案:对组合逻辑电路在电路结构上只由逻辑门组成,不包含记忆元件,输入和输出之间无反馈,因而其功能特点是入变出即变。
答案:对下列属于译码器芯片的是()。
答案:74HC139;74HC138;74HC4511;74HC42/star3/origin/b7437c2ba3093b8e6c24c02a2f474240.jpg
答案:和C下列器件任何时刻只允许有1个有效信号到达输入端。
答案:普通编码器/star3/origin/63fac5720e107ac026a4ee246d90237a.jpg
答案:Y=m(1,2,4,7,8,11,13,14)/star3/origin/8ebb124adc46cf90e8372ccab90c6312.png
答案:100/star3/origin/4d23ed2de87a776940aa89f8c4c7cfda.png
答案:B=C=0当七段显示译码器的七个输出端状态为abcdefg=0011111时(高电平有效),译码器输入状态(8421BCD码)应为()。
答案:0110设计一个裁判表决电路。裁判组由三个人组成:主裁判A、副裁判B和C。在判定一次比赛的结果时必须按照如下原则:只有当两个或两个以上裁判支持,并且其中有一个为主裁判时,比赛结果的裁决才有效。令A、B、C为1表示支持,为0表示反对。裁决Y为1表示有效,为0表示无效。下列表达式中能够实现该电路功能的是()。
答案:Y=AB+AC一个8421BCD码译码器的数据输入线与译码输出线的组合是()。
答案:4:10组合逻辑电路中的竞争冒险是由()引起的。
答案:门电路的延时一个译码器若有100个译码输出端,则译码器地址输入端至少有()个。
答案:7一个十六路数据选择器,其地址输入(选择控制端输入)端有()个。
答案:4/star3/origin/2be5b5ebb50fe794f76c697f61ba6435.jpg
答案:或非门下列CMOS门可以将输出端并接使用的是(
)。
答案:三态门;漏极开路门;传输门/star3/origin/e1f2d88331c11c6d7d31cdde69c101fb.png
答案:或非门能实现线与逻辑功能的门电路是()。
答案:CMOS漏极开路门正逻辑的或同负逻辑的()对应。
答案:与利用数字电路不仅可以实现数值运算,还可以实现逻辑运算。
答案:对数字和字符可以编码,但标点符号是无法编码的
答案:错有权码1001一定表示十进制数9
答案:错若两个函数具有不同的逻辑函数式,则两个逻辑函数必然不相等。
答案:错逻辑变量的取值,1肯定比0大。
答案:错表示任意两位无符号十进制数需要()二进制数。
答案:7/star3/origin/6190171bfb965c477f4fcfe2168048fe.png
答案:Y=A异或B一只四输入端或非门,使其输出为1的输入变量取值组合有()种。
答案:1十进制数2004等值于八进制数()
答案:37248位二进制补码(11111111)B所对应的十进制数真实值是
答案:-18位无符号二进制数(11111111)B所对应的十进
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