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文档简介

1、 SOC SOC1.hierarchicalcel旋转翻转问题？完成。【覃晓莹，20141128】CLOSE 2.130nm clko2net 的属性？完成。【覃晓莹，20141128】CLOSE3.RFicc 阶段。【覃晓莹，20141128】OPEN (原因，在进行新代码的VCS DC hierarchical 综合）4.对高扇出的tie off 单元进行High fanout synthesis。询问海思用对每个tiecell进行一对一连接【黄灼泉，杨斯媚. 20141202/】OPEN5.电源 6set_activity_factor 在DC 阶段的应用还没处理好需要李枫产生一个sai

2、f文【李7、EMAAEMAB的设置海思那边是用寄存器可配置，先用默认值20141201】 王政集了旧服务器的license，不过只能用于2010年版本的工具。GCC 目2、海思那边说EMAA 的设置可用一个寄存器进行配置，出片后在配置调节，的值。Tie_cell 在 dc 不用处理，在 icc 用一个接地或接电源线连一个tie cell。3、PLL工艺厂相关OCV 的事情给伍总打过旋转（其内单元布局也随之翻转）block 关于x 轴对称的翻转。2.130nmclko2netsignalnetall_connectivity_fanoutfrom*flat130nmcs256网表中多 了许多 b

3、uf/inv，减少了扇出数量。 手动地在 clko2 输出端 了一个 clko2_buf852 个，但是并没有影响到单元延时。Prob1ideal 而该单元为clko2时钟的时钟源点， 在设计中采取的方法是，在该时钟源点后手动 一个clko2buf（buf）net 时序情况。 - - 总结之前违例出现的原因：set_ideal_network all_fanout -flat -clock_tree 命令对所有net都能起作用。但是当remove_sdcsdc重新采用这条命令对所有时钟netidealgcc重新采用这条命令对所有时钟netidealgcc问题解决了，学习VCSUCLI和DVE的用法，正在跑VCS lab。tie-hightie-low在DC网表时禁用PLL0和PLL1单元在ICC阶段的网表的单元是有tie-high， tie-low 的性质，connect_tie_cell 是用于自动tie 单元的。师兄说个tie-high/low 的引脚连一个单元，下周进行这部分工作。下下周做个下Q3D的数据结果和HFSS的相关提bottom-up模式

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