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文档简介
1、led_shrftingdisplay30CLK IMRSTLZ1led_shiftingdispiayI、总体 RTL SCHEMATIC 卡二-1F1:冃AHWi-i ft二.4LED :点亮LED灯DDPP课程设计八位LED可控移位显示设计与实现本设计基于Xilinx ISE Design Suite 13.2软件开发平台和其综合工具进行八位LED可控移位显示数字电路的功能设计,在FPGA BSSYS2开发板上来完成设计的测试和实现。端口说明:CLK_IN : 50MHZ 时钟输入C:控制左右移,0为LED0-LED7,1 反之。S:选择移动频率,共四档。RST :重置II、源程序mod
2、ule led_shifti ngdisplay(LED,CLK_IN,RST,S,C); in put CLK_IN,RST,C;in put 1:0 S;output 7:0 LED;reg 25:0 cn;reg CLK;reg 7:0 LED;wire CLK OUT;wire CLK2_0UT;wire CLK3_0UT;wire CLK4_0UT;in itialbegincn=0;endalways (posedge CLK_IN) beginif(c n=49999999) begi n cn<=0; end else cn<=c n+26'd1;endas
3、sig n CLK_OUT=cn25;1HZassig n CLK2_OUT=c n24;/2HZassig n CLK3_OUT=c n 21;16HZassig n CLK4_OUT=c n20;32HZalways (S,CLK_OUT,CLK2_OUT,CLK3_OUT,CLK4_OUT)begincase(S)2'dO:CLK<=CLK_OUT;2'd1:CLK<=CLK2_OUT;2'd2:CLK<=CLK3_OUT;2'd3:CLK<=CLK4_OUT;endcaseendin itial begin LED=8'b
4、00000000;e ndalways (posedge CLK)beginif(C)C=1,left shifti ngif(RST) LED<=8'b00000001;else if(LED=8'b00000000)LED<=8'b00000001;else LED<=LED<<1;elseC=1,right shift ingif(RST) LED<=8'b10000000;else if(LED=8'b00000000)LED<=8'b10000000;else LED<=LED>&g
5、t;1;end en dmoduleIII、用户约束文件 led_shiftingdisplay.vNET "C" LOC = N3;NET "CLK_IN" LOC = B8;NET "LED0" LOC = M5;NET "LED1" LOC = M11;NET "LED2" LOC = P7;NET "LED3" LOC = P6;NET "LED4" LOC = N5;NET "LED5" LOC = N4;NET "
6、LED6" LOC = P4;NET "LED7" LOC = G1;NET "RST" LOC = A7;NET "S0" LOC = P11;NET "S1" LOC = L3;# Plan Ahead Gen erated IO con stra intsNET "C" IOSTANDARD = LVCMOS33;NET "CLK_IN" IOSTANDARD = LVCMOS33;NET "LED0" IOSTANDARD = LVCMO
7、S33;NET "LED1" IOSTANDARD = LVCMOS33;NET "LED2" IOSTANDARD = LVCMOS33;NET "LED3" IOSTANDARD = LVCMOS33;NET "LED4" IOSTANDARD = LVCMOS33;NET "LED5" IOSTANDARD = LVCMOS33;NET "LED6" IOSTANDARD = LVCMOS33;NET "LED7" IOSTANDARD = LVCM
8、OS33;NET "RST" IOSTANDARD = LVCMOS33;NET "S0" IOSTANDARD = LVCMOS33;NET "S1" IOSTANDARD = LVCMOS33;IV、程序仿真测试文件 led_shiftingdisplay.v module test_ledshift in gdisplay;reg CLK_IN;reg RST;reg 1:0 S;reg C;wire 7:0 LED;led_shift in gdisplay uut (.LED(LED), .CLK_IN(CLK_IN), .RST(RST), .S(S),.C(C);parameter PERIOD = 20;in itialbeginCLK_IN = 1'bO;#10;forever#(PERIOD/2) CLK_IN = CLK_IN;endin itial begi n RST = 0;S = 3;C = 1;enden dmodule仿真波形:NamcWaliHLzzj-xui旨KT«4u和1 CuKJKi侖 CLK.OuTe«CAI4:扁 ClF SJJ.F" r. I.*1 - MMHMKWNtI I II -密癱-JIrLTLrUTnrL
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